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数字电路中 时序图的空翻现象是怎么回事(数字电路波形图怎么理解)

数字电路中 时序图的空翻现象是怎么回事(数字电路波形图怎么理解)

更新时间:2024-05-30 10:19:56

数字电路中 时序图的空翻现象是怎么回事

空翻是因为干扰导致输入引脚电平突变引起锁存器逻辑值发生变化。解决的方法是在数字ic的电源上并联电容。不用的输入引脚接固定电平。coms的数字电路可以接任意的电平。TTL的输入接地。

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